MATLAB實(shí)訓(xùn)小結(jié)

一、實(shí)訓(xùn)小結(jié)為期一個星期的MATLAB實(shí)訓(xùn)已經(jīng)結(jié)束，雖然時間很短，但我還是從中學(xué)到了很多，對MATLAB有了一定的了解。Matlab是一個基于矩陣運(yùn)算的軟件，它的運(yùn)算功能非常強(qiáng)大，編程效率高，強(qiáng)大而智能化的作業(yè)圖功能，可擴(kuò)展性強(qiáng)，simulink動態(tài)仿真功能，主要用于仿真、驗(yàn)證、算法思想是否正確。在這段時間里，我們主要學(xué)習(xí)MATLAB的工具的使用，熟悉其最基礎(chǔ)的功能，鍛煉了我的實(shí)際動手能力。Help是MATLAB中最有效的命令。遇到問題，通常都可以借助help解決問題。老師一再給我們強(qiáng)調(diào)了help的重要性。下面是我對help的一些常用方法的總結(jié)：(1)命令窗口直接敲“help”，你就可以得到本地機(jī)器上matlab的基本的幫助信息。(2)對于某些不是很明確的命令，只知道大體所屬范圍，譬如說某個工具箱，直接在命令窗口中敲入helptoolboxname，一幫可以得到本工具箱有關(guān)的信息：版本號，函數(shù)名等。(3)知道函數(shù)名，直接用helpfunname就可以得到相應(yīng)的幫助信息。我覺得想要學(xué)好MATLAB是不容易的，這是一件需要持之以恒的事，必須要堅持不懈的學(xué)習(xí)，還需要敢于開口向別人請教，更需要我們勤于思考，勤于記憶，勤于動手。程序設(shè)計是實(shí)踐性和操作性很強(qiáng)的事情，需要我們親自動手。因此，我們應(yīng)該經(jīng)常自己動手實(shí)際操作設(shè)計程序，熟悉MATLAB的操作，這對提高我們的操作能力非常有效。在這幾天時間里，我僅僅是學(xué)了一點(diǎn)點(diǎn)皮毛，想要進(jìn)一步的學(xué)習(xí)，還需要我在以后的的實(shí)際運(yùn)用里不斷地學(xué)習(xí)，改進(jìn)自己的不足之處，讓自己能夠有所進(jìn)步，有所成長。二、資料翻譯英文部分：TimeSeriesArraysAtimeseriesisanorderedsetofobservationsstoredinaMATLABarray.Therowsofthearraycorrespondtotime-taggedindices,orobservations,andthecolumnscorrespondtosamplepaths,independentrealizations,orindividualtimeseries.Inanygivencolumn,thefirstrowcontainstheoldestobservationandthelastrowcontainsthemostrecentobservation.Inthisrepresentation,atimeseriesarrayiscolumn-oriented.NoteSomeEconometricsToolboxfunctionscanprocessunivariatetimeseriesarraysformattedaseitherroworcolumnvectors.However,manyfunctionsnowstrictlyenforcethecolumn-orientedrepresentationofatimeseries.Toavoidambiguity,formatsinglerealizationsofunivariatetimeseriesascolumnvectors.Representingatimeseriesincolumn-orientedformatavoidsmisinterpretationofthearguments.ItalsomakesiteasierforyoutodisplaydataintheMATLABCommandWindow.Conditionalvs.UnconditionalVarianceThetermconditionalimpliesexplicitdependenceonapastsequenceofobservations.Thetermunconditionalappliesmoretolong-termbehaviorofatimeseries,andassumesnoexplicitknowledgeofthepast.TimeseriestypicallymodeledbyEconometricsToolboxsoftwarehaveconstantmeansandunconditionalvariancesbutnon-constantconditionalvariances.AutomatedHDLCodeGenerationHardwaredescriptionlanguage(HDL)codegenerationacceleratesthedevelopmentofapplication-specificintegratedcircuit(ASIC)andfieldprogrammablegatearray(FPGA)designsandbridgesthegapbetweensystem-leveldesignandhardwaredevelopment.Traditionally,systemdesignersandhardwaredevelopersuseHDLs,suchasveryhighspeedintegratedcircuit(VHSIC)hardwaredescriptionlanguage(VHDL)andVerilog,todevelophardwaredesigns.AlthoughHDLsprovideaprovenmethodforhardwaredesign,thetaskofcodingfilterdesigns,andhardwaredesignsingeneral,islaborintensiveandtheuseoftheselanguagesforalgorithmandsystem-leveldesignisnotoptimal.UsersoftheFilterDesignHDLCoderproductcanspendmoretimeonfine-tuningalgorithmsandmodelsthroughrapidprototypingandexperimentationandlesstimeonHDLcoding.Architectsanddesignerscanefficientlydesign,analyze,simulate,andtransfersystemdesignstohardwaredevelopers.Inatypicalusescenario,anarchitectordesignerusesFilterDesignToolboxGUIs(FDAToolorfilterbuilder)todesignafilter.Then,adesignerusestheFilterDesignHDLCoderGUIorcommand-lineinterfacetoconfigurecodegenerationoptionsandgenerateaVHDLorVerilogimplementationofthedesignandacorrespondingtestbench.ThegeneratedcodeadherestoacleanHDLcodingstylethatenablesarchitectsanddesignerstoquicklyaddresscustomizations,asneeded.Thetestbenchfeatureincreasesconfidenceinthecorrectnessofthegeneratedcodeandsavespotentialtimespentontestbenchimplementation.ExpectedUsersUsersoftheFilterDesignHDLCodersoftwarearesystemandhardwarearchitectsanddesignerswhodevelop,optimize,andverifyhardwaresignalfilters.ThesedesignersareexperiencedwithVHDLorVerilog,butcanbenefitgreatlyfromatoolthatautomatesHDLcodegeneration.TheFilterDesignHDLCoderinterfaceprovidesdesignerswithefficientmeansforcreatingtestsignalsandtestbenchesthatverifyalgorithms,validatingmodelsagainststandardreferencedesigns,andtranslatelegacyHDLdescriptionsintosystem-levelviews.Usersareexpectedtohaveprerequisiteknowledgeinthefollowingsubjectareas:HardwaredesignandsystemintegrationVHDLorVerilogHDLsimulatorsUsersarealsoexpectedtohaveexperiencewiththefollowingproducts:MATLABFilterDesignToolboxKeyFeaturesandComponentsKeyfeaturesoftheFilterDesignHDLCodersoftwareincludethefollowing:Graphicaluserinterface(GUI)accessiblefromFilterDesignandAnalysisTool(FDATool),filterbuilder,orMATLABcommandlineMATLABcommand-lineinterfaceSupportforthefollowingdiscrete-timefilterstructures時間序列的數(shù)組一個時間序列的有序集合,它包括帶有發(fā)音觀察儲存在一個MATLAB的數(shù)組。一排排的數(shù)組time-tagged對應(yīng)身體質(zhì)量指數(shù)、或觀察,柱與樣品的路徑,獨(dú)立意識,或個人時間序列。在任何給定的專欄,第一排最古老的觀察,包括最后一排包含最近的觀察。這表示、時間序列column-oriented陣列。注意：一些經(jīng)濟(jì)學(xué)工具箱中的音符可單變量的時間序列的功能或者格式化為數(shù)組的行或列向量。然而,許多功能現(xiàn)在嚴(yán)格執(zhí)行column-oriented表示的時間序列。為了避免含糊不清,格式的單變量的時間序列的單一作為柱向量。代表時間序列中避免誤解,column-oriented格式的觀點(diǎn)。它也能使你更容易顯示數(shù)據(jù)的MATLAB指揮的窗口。條件和無條件的方差這個學(xué)期有條件的暗示明確依賴過去序列的觀察報告。這個學(xué)期無條件的行為更長遠(yuǎn)的運(yùn)用時間序列,并承擔(dān)任何明確的過去的知識。時間序列模擬軟件工具箱中的典型計量方式和有一定的差異,但非常條件方差無條件。自動化生成硬件描述語言的代碼硬件描述語言的代碼生成發(fā)展加速專用集成電路(ASIC)和現(xiàn)場可編程門陣列（FPGA）器件的設(shè)計和彌合系統(tǒng)設(shè)計及硬件的發(fā)展之間的差距。傳統(tǒng)上,系統(tǒng)設(shè)計者和硬件開發(fā)商使用HDLs,如高速集成電路(VHSIC)硬件描述語言(VHDL)和Verilog、開發(fā)硬件設(shè)計。雖然HDLs提供一個行之有效的方法,這個任務(wù)的硬件設(shè)計、軟件和硬件設(shè)計,編碼濾波器設(shè)計一般是勞動密集型行業(yè),使用這些語言的系統(tǒng)設(shè)計的算法,并不是最佳的。用戶過濾設(shè)計硬件描述語言(HDL)編碼器產(chǎn)品可以投入更多的時間于微調(diào)算法和模型,通過實(shí)驗(yàn)和快速成型,少花些時間在高密度脂蛋白(HDL)的代碼。建筑師與設(shè)計者能夠有效地設(shè)計、分析、仿真系統(tǒng)的設(shè)計,并轉(zhuǎn)移到硬件開發(fā)商。在一個典型的使用情況下,建筑師和設(shè)計師用濾波器設(shè)計工具箱FDATool或filterbuilder(設(shè)計)的過濾。然后,設(shè)計師采用濾波器設(shè)計和命令行界面的硬件描述語言(HDL)編碼器GUI代碼生成選擇和配置產(chǎn)生一個硬件描述語言(VHDL)或Verilog設(shè)計和實(shí)施相應(yīng)的試驗(yàn)臺。生成的代碼堅持一個精簡的硬件描述語言(HDL)的編碼風(fēng)格,使建筑師和設(shè)計師們迅速解決定制,所需要的產(chǎn)品。該試驗(yàn)臺的功能增加信心的正確性,節(jié)省潛力產(chǎn)生代碼的執(zhí)行時間花在試驗(yàn)臺。潛在用戶用戶過濾軟件系統(tǒng)的設(shè)計硬件描述語言(HDL)編碼器建筑師與設(shè)計者和硬件發(fā)展、優(yōu)化、驗(yàn)證硬件信號濾光片。這些設(shè)計經(jīng)驗(yàn)的地位和作用,但可以Verilog或者受益匪淺,自動化工具硬件描述語言(HDL)的代碼生成。過濾設(shè)計硬件描述語言(HDL)編碼器界面提供高效的設(shè)計師為創(chuàng)建測試信號和試驗(yàn)驗(yàn)證,驗(yàn)證的長凳上對算法的模型,并將參考設(shè)計標(biāo)準(zhǔn)描述成硬件描述語言(HDL)的系統(tǒng)觀點(diǎn)遺留。用戶將有望知道下列各方面的知識：1.硬件設(shè)計,系統(tǒng)集成2.硬件描述語言(VHDL)或Verilog3.硬件描述語言（HDL）模擬器用戶還希望有產(chǎn)品有如下作用:1.MATLAB2.濾波器設(shè)計工具箱主要特點(diǎn)和組件：過濾軟件設(shè)計硬件描述語言(HDL)編碼器的主要特點(diǎn)如下:1.圖形用戶界面(GUI)可從濾波器的設(shè)計和分析工具(FDATool),filterbuilder或MATLAB命令行2.MATLAB的命令行界面3.支持以下的離散濾波器結(jié)構(gòu)。

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1.社會及技術(shù)背景

Matlab即“Matrixlab”的簡稱，即“矩陣實(shí)驗(yàn)室”，是進(jìn)行工程計算和

系統(tǒng)仿真的有力工具，被稱為“演草紙式的計算器”，它的基本數(shù)據(jù)單位是數(shù)組（或者矩陣），這對于現(xiàn)代工程計算提供了很大的方便，避免了傳統(tǒng)的編程語言中對每個元素進(jìn)行計算而循環(huán)的步驟，非常方便。新版的matlab6.0及以上的版本提供了綜合型在線幫助文庫helpdesk，該文庫以HTML超文本形式獨(dú)立存在。用戶可以方便的進(jìn)行檢索和查詢幫助。Matlab有優(yōu)良的界面和畫圖功能，能簡單的調(diào)用程序畫出優(yōu)美的三維和二位維靜止和動態(tài)圖像，極大地豐富了計算的效果。并提供了matlab與其他編程語言（c、fortran）的接口，使之可以方便的生成.exe可執(zhí)行文件。

…

2.學(xué)習(xí)matlab的目的與意義

MATLAB是數(shù)學(xué)軟件中功能最為齊全的，它有很較為全面的功能便于你

用一個軟件解決大多數(shù)問題。

重要的是，如果你是需要設(shè)計成長曲線之類的，那MATLAB的繪圖功能也會給你很大幫助。

我也是數(shù)學(xué)系的，但現(xiàn)在對MATLAB只有比較淺層次的了解，不過我認(rèn)為，學(xué)精MATLAB對選擇更好的職業(yè)沒有太大意義。各大行業(yè)中的強(qiáng)勢企業(yè)，極少用這些公開的軟件處理企業(yè)中的問題，即使使用，那也肯定只是在低層次為了處理方便而使用。

學(xué)習(xí)MATLAB，或其它軟件，重要的不是掌握軟件本身，而是增強(qiáng)自己學(xué)習(xí)新能力的能力，只有這個得到強(qiáng)化，才能適應(yīng)。

3.分析與實(shí)現(xiàn)

題目：在同一幅圖上繪制函數(shù)yt范圍0-2

2etsin(2t)及其包絡(luò)線圖形，

為完成任務(wù)，用到y(tǒng)2etsin(2t)。由此得到代碼：

4t=0:0.01:2;

y=sqrt(2)*exp(-t).*sin(2*pi*t+pi/4);y1=sqrt(2)*exp(-t);y2=sin(2*pi*t+pi/4);plot(t,y)holdon

plot(t,y1,"r:",t,-y1,"r:")

先在0~2之間產(chǎn)生數(shù)據(jù)，間距可以任意取，這里取間距為0.2，然后就是數(shù)組的算術(shù)表達(dá)，其中要注意幾點(diǎn)：A.*B數(shù)組A和B對應(yīng)元素相乘；a./b數(shù)組a除以b的對應(yīng)元素，a.^ba和b對應(yīng)元素的乘方。還有要用到plot函數(shù)，ploy（y）繪制以y為縱坐標(biāo)的二維函數(shù)，ploy（x，y）繪制以x為橫坐標(biāo)y為縱坐標(biāo)的二維函數(shù)，ploy（x1，y1，x2，y2，…）在同一窗口繪制多條二維曲線。

1.510.50-0.5-1-1.500.20.40.60.811.21.41.61.4.總結(jié)

我覺得想要學(xué)好MATLAB是不容易的，這是一件需要持之以恒的事，必須

要堅持不懈的學(xué)習(xí)，還需要敢于開口向別人請教，更需要我們勤于思考，勤于記憶，勤于動手。程序設(shè)計是實(shí)踐性和操作性很強(qiáng)的事情，需要我們親自動手。因此，我們應(yīng)該經(jīng)常自己動手實(shí)際操作設(shè)計程序，熟悉MATLAB的操作，這對提高我們的操作能力非常有效。

在這幾天時間里，我僅僅是學(xué)了一點(diǎn)點(diǎn)皮毛，想要進(jìn)一步的學(xué)習(xí)，還需要我在以后的的實(shí)際運(yùn)用里不斷地學(xué)習(xí)，改進(jìn)自己的不足之處，讓自己能夠有所進(jìn)步，有所成長。

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